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一种存储器低失配时钟输出电路
文献摘要：
随着动态随机存取存储器(DRAM)的工作频率不断提高,导致DRAM芯片的时钟输出电路中的时钟树信号线路径需要完全匹配,甚至相同.本文论述了一种低失配时钟输出电路设计,包括时钟产生电路、供电模块、以及多个时钟输出模块,时钟产生电路与时钟输出模块之间均通过时钟树信号线连接,供电模块与时钟输出模块之间均通过电源线连接,时钟树信号线采用树状结构布线,电源线也同样采用树状结构布线,从而实现消除时钟输出模块之间电源的失配,提高系统性能.
文献关键词：
DRAM;时钟输出电路;树状结构布线
中图分类号：
作者姓名：
薛小飞;王棋;韩彦武;龙晓东
作者机构：
西安紫光国芯半导体有限公司
文献出处：
引用格式：
[1]薛小飞;王棋;韩彦武;龙晓东-.一种存储器低失配时钟输出电路)[J].中国集成电路,2022(01):71-73
A类：
时钟输出电路,树状结构布线
B类：
失配,动态随机,随机存取存储器,DRAM,工作频率,时钟树,信号线路,文论,电路设计,供电模块,输出模块,电源线,系统性能
AB值：
0.158609
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